Über diesen Kurs

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Stufe „Mittel“
Ca. 18 Stunden zum Abschließen
Englisch
Untertitel: Englisch

Kompetenzen, die Sie erwerben

Primality TestVerilogDigital DesignStatic Timing Analysis
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University of Colorado Boulder

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Dieses Kurs ist Teil des reinen Onlineabschlusses Master of Science in Electrical Engineering von University of Colorado Boulder. Wenn Sie in das komplette Programm aufgenommen werden, werden Ihre Kurse auf Ihren Abschluss angerechnet.

Lehrplan - Was Sie in diesem Kurs lernen werden

InhaltsbewertungThumbs Up94%(2,598 Bewertungen)Info
Woche
1

Woche 1

4 Stunden zum Abschließen

What's this programmable logic stuff anyway? History and Architecture

4 Stunden zum Abschließen
9 Videos (Gesamt 46 min), 4 Lektüren, 2 Quiz
9 Videos
Course Overview6m
1. Welcome to the world of programmable logic and FPGA design1m
2. A Brief History of Programmable Logic9m
3. CPLD Architecture5m
4. LUTs and FPGA Architecture8m
5. LUTs for Logic Design2m
6. Designing Adders6m
7. Designing Multipliers3m
4 Lektüren
About This Course10m
Hardware Requirements10m
Week 1 Suggested Readings1h 20m
Week 2 Assignment Instructions and Files10m
1 praktische Übung
Mission 002: Week 1 Quiz30m
Woche
2

Woche 2

4 Stunden zum Abschließen

FPGA Design Tool Flow; An Example Design

4 Stunden zum Abschließen
11 Videos (Gesamt 121 min), 1 Lektüre, 3 Quiz
11 Videos
2. Downloading Quartus Prime2m
3. Installing Quartus Prime2m
4. Introducing Quartus Prime11m
5. Create a design project in Quartus Prime7m
6. Create a design in Quartus Prime13m
7. Compile a Design17m
8. View the RTL16m
9. Timing Analysis with Time Quest I9m
10. Timing Analysis with Time Quest II16m
11. Simulate a design with ModelSim17m
1 Lektüre
Week 2 Suggested Readings20m
2 praktische Übungen
Mission 003 : Practice Opportunity30m
Mission 005: Week 2 Quiz30m
Woche
3

Woche 3

3 Stunden zum Abschließen

FPGA Architectures: SRAM, FLASH, and Anti-fuse

3 Stunden zum Abschließen
8 Videos (Gesamt 80 min), 2 Lektüren, 1 Quiz
8 Videos
2. Xilinx CPLD Architecture7m
3. Xilinx Small FPGAs8m
4. Xilinx Large FPGAs11m
5. Altera CPLDs and Small FPGAs8m
6. Altera Large FPGAs9m
7. Microsemi Single-chip FPGA solutions14m
8. Lattice Single-Chip FPGA solutions14m
2 Lektüren
Week 3 Suggested Readings1h 20m
Week 4 Assignment Instructions and Files10m
1 praktische Übung
Mission 006: Week 3 Quiz30m
Woche
4

Woche 4

6 Stunden zum Abschließen

Programmable logic design using schematic entry design tools

6 Stunden zum Abschließen
10 Videos (Gesamt 180 min), 1 Lektüre, 2 Quiz
10 Videos
2. Advanced Schematic Entry for FPGA Design- Drawing and Hierarchy26m
3. Improving Productivity with IP Blocks25m
4. Improving Timing with Pipelining18m
5. FPGA IO: Getting In and Getting Out8m
6. Pin Assignments: Making them Spot On!20m
7. Programming the FPGA10m
8. Becoming one with Q: Qsys System Design20m
9.a Becoming one with Q Part II: Qsys System Design Finishing Touches25m
9.b Becoming one with Q Part III: Qsys System Design Finishing Touches19m
1 Lektüre
Week 4 Suggested Readings1h 10m
1 praktische Übung
Mission 008: Week 4 Quiz30m

Bewertungen

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Häufig gestellte Fragen

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